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VHDL 실습(8bit Counter, State Machine) 결과

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작성일 22-10-16 13:11

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실험과제/전기전자
디지털공학實驗 VHDL 실습(8bit Counter, State Machine) 결과 보고서 1. 8Bit Counter
`Module`

`Test Bench`

`Simulation`

`진리표 및 검토`

ClrN 0 1 1 . . .

LdN X 0 1 . . .

P X X 1 . . .

T1 X X 1 . . .

D1&D2 X D1&D2 D1&D2 . . .

Q 00000000 D1&D2 D1&D2+1 . . .

☞ 이번에 설계한 8비트 카운터는 4비트 카운터 2개를 이용하여 구성하였다. 2개 중 왼쪽(앞쪽)에 있는 4비트 카운터 의 Carry값이 1일 때만 동작…(생략(省略))

설명

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다.

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